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verilog reg类型有高阻态吗
问题更新日期：2024-06-21 22:44:55
问题描述
verilog reg类型有高阻态吗急求答案，帮忙回答下
- 精选答案
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一般verilog的高阻，是用wire的方式再assign一级得到的。regr;inoutio;assignio=vld r:1'bz;同时io还可以作为输入直接用。vhdl和log肯定有不太一样的地方，但是大体功能差别不大，都是表述硬件的语言。
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